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當(dāng)幾年前結(jié)構(gòu)化ASIC剛問世時(shí),人們認(rèn)為它為小型系統(tǒng)制造商提供了在標(biāo)準(zhǔn)單元ASIC和FPGA之外的第三種選擇。

然而,隨著結(jié)構(gòu)化ASIC的不斷發(fā)展,它不再僅僅為小公司所用。在某些情況下,大型芯片公司也禁不住誘惑,選擇結(jié)構(gòu)化ASIC作為解決芯片快速上市或研發(fā)預(yù)算緊張等問題的良方。

Altera公司宣布,TI已在其數(shù)字光處理器(DLP)芯片組中選用了它的HardCopy結(jié)構(gòu)化ASIC。而在此之前,英飛凌宣布采用HardCopy開發(fā)出了一款面向Ethernet-over-Sonet(EoS)應(yīng)用的器件。

為什么上述公司雖然擁有自己的芯片設(shè)計(jì)隊(duì)伍,卻要采用其它公司的資源呢？據(jù)Altera表示,使用傳統(tǒng)設(shè)計(jì)方法時(shí),設(shè)計(jì)、調(diào)試和完成一個(gè)ASIC原型的最短周期是固定的。如果一家芯片公司想在即將召開的展覽會(huì)上展示最新成果,但進(jìn)度卻落后于預(yù)定計(jì)劃時(shí),結(jié)構(gòu)化ASIC就是突破困境的法寶。Altera透露,在TI的案例中,Altera可以在設(shè)計(jì)定案后的10周內(nèi)交付首批HardCopy樣片。

“標(biāo)準(zhǔn)ASIC的開發(fā)需耗時(shí)兩年,而且時(shí)間并不會(huì)因投入資源的增多而減少。在某一點(diǎn)上,你無(wú)法進(jìn)一步壓縮設(shè)計(jì)周期。”Altera的HardCopy產(chǎn)品部副總裁Alain Bismuth表示,“當(dāng)我和另一家大型半導(dǎo)體公司會(huì)談時(shí),他們告訴我的是完全相同的結(jié)論。”

結(jié)構(gòu)化ASIC的密度及速度都不能與標(biāo)準(zhǔn)單元器件相比,但卻勝于FPGA,而且原型設(shè)計(jì)時(shí)間比標(biāo)準(zhǔn)單元芯片更短。對(duì)某些公司或某些項(xiàng)目而言,這些理由足以支持他們利用結(jié)構(gòu)化ASIC去開發(fā)一款足夠好的芯片。

其它的結(jié)構(gòu)化ASIC供應(yīng)商也報(bào)告了半導(dǎo)體公司對(duì)結(jié)構(gòu)化ASIC的高度興趣。臺(tái)灣智原科技公司大約在一年前推出首款結(jié)構(gòu)化ASIC平臺(tái),目前已有10家公司使用其產(chǎn)品。其中,三分之二的客戶是芯片公司,智原科技負(fù)責(zé)國(guó)際業(yè)務(wù)的副總裁Charlie Chen介紹道。

Chen表示,許多公司都認(rèn)為開發(fā)微米芯片的巨額成本是令它們望而卻步的原因。“除非一年有一百萬(wàn)的出貨量,否則毫無(wú)意義。”他說(shuō)。

在智原科技的案例中,芯片在交付客戶之前有60%是標(biāo)準(zhǔn)單元門。預(yù)制部分包括一些模塊,如用于以太網(wǎng)標(biāo)準(zhǔn)或DDR存儲(chǔ)器的控制邏輯等。

很難說(shuō)芯片公司是否將磨跟接踵地向結(jié)構(gòu)化ASIC轉(zhuǎn)移。結(jié)構(gòu)化ASIC供應(yīng)商通常是不允許公開客戶名單的,因此當(dāng)Altera獲準(zhǔn)可以引用一些大型芯片公司的名字時(shí),理所當(dāng)然它一定會(huì)充分利用這個(gè)機(jī)會(huì)。

Altera的頭號(hào)競(jìng)爭(zhēng)對(duì)手Xilinx,仍然對(duì)結(jié)構(gòu)化ASIC嗤之以鼻,而這恰給了Altera更多的理由對(duì)結(jié)構(gòu)化ASIC進(jìn)行大量宣傳。最起碼,這次的客戶宣布使那些未采取行動(dòng)的廠商開始對(duì)結(jié)構(gòu)化ASIC予以關(guān)注。

作者: 趙子龍