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對于高頻系統(tǒng)來說,電磁干擾(EMI)是個不小的危害,噪聲具有頻譜寬、隱蔽性強、難于消除等特點,因此將噪聲抑制到最小對提高系統(tǒng)性能指標(biāo)是必要的。對于抑制噪聲、減小EMI,可以通過改進(jìn)電源方案、降低電源噪聲、優(yōu)化時鐘方案、正確產(chǎn)生邏輯信號,以及設(shè)計接口電路和信號線連接部分。本文將闡述如何通過上述方案減小高頻系統(tǒng)控制電路產(chǎn)生的噪聲以提高系統(tǒng)性能。

可編程邏輯器件內(nèi)置鎖相環(huán),可以保持與外部時鐘的同步,同時還可滿足倍頻需要,可編程邏輯器件還內(nèi)置全局時鐘總線,可滿足邏輯的同步建立。為了驅(qū)動外部TTL設(shè)備,控制系統(tǒng)采用了可編程邏輯器件和高速CMOS器件進(jìn)行緩沖,為了實現(xiàn)長距離傳輸,還需對輸出信號進(jìn)行終端匹配。接口部分指的是接插件,接插件具有較大的引線電感,很容易造成信號傳輸線的阻抗不匹配,因此需要做好屏蔽才能減少EMI問題。

電路的電源及接地部分設(shè)計

邏輯器件的供電并不是單電壓的,還需要DC-DC輸出的5V直流通過LDO進(jìn)行變壓,LDO對DC-DC輸出的電壓中的噪聲部分還可進(jìn)一步抑制,尤其是對高頻部分,通過2個LDO,將5V直流電壓變到和兩組輸出到可編程器件。DC-DC去耦處理如圖2。

時鐘信號線最大走線長度計算

r/2)*V_P

P=

r:信號上升沿時間,取4ns；

P:信號在微帶線中傳輸?shù)乃俣龋?

8m/s,因此,始終信號線最大走線長度。

電路的邏輯部分設(shè)計

編程器件之間串接一個100歐姆電阻進(jìn)行限流,以保證可編程器件的使用安全。

電路的接口部分設(shè)計

本文小結(jié)

作者:孫亞光

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